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[DSP] 请教个CPLD的问题

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发表于 2022-9-15 10:07:50 | 显示全部楼层 |阅读模式

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本帖最后由 inthsunshine 于 2022-9-15 10:12 编辑

因需要对一个芯片读取数据, 并行16位,每次有2个数据,分时出现,比如数据A,  再数据B,   隔一段时间,再数据A,  数据B,  以此循环

因为数据A和B持续的时间很短,大概10ns,  单片机来不及读取,虽然设想利用D触发器进行锁存,再读取,用逻辑电路实现稍复杂,也占位置

想着能不能利用CPLD实现, 没接触过CPLD特请教一下懂的人

我想实现这样的功能, 就是当数据A和B出现时,用2组寄存器(每组16个)分别进行锁存记忆(由被读取的芯片提供相关信号指示线), 然后把2组寄存器输出连在一起(三态输出), 由单片机提供选择信号,来选择具体输出哪一组数据(比如0选择数据A,1选择数据B).

可以吗?
发表于 2022-9-15 11:30:24 | 显示全部楼层
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 楼主| 发表于 2022-9-15 15:40:38 | 显示全部楼层
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发表于 2022-9-15 19:53:30 | 显示全部楼层
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发表于 2022-9-16 03:01:59 | 显示全部楼层
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发表于 2022-9-16 08:04:35 | 显示全部楼层
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 楼主| 发表于 2022-9-16 09:35:13 | 显示全部楼层
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发表于 2022-9-16 11:08:41 | 显示全部楼层
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发表于 2022-9-16 15:39:13 | 显示全部楼层
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发表于 2022-9-17 06:34:19 来自手机浏览器 | 显示全部楼层
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 楼主| 发表于 2022-9-17 10:35:45 | 显示全部楼层
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